二維（2D）半導(dǎo)體縮放技術(shù)曾憑借更低的成本，實(shí)現(xiàn)了更高的存儲(chǔ)密度與容量。然而，無(wú)論是SRAM還是DRAM，傳統(tǒng)的2D縮放都已步入尾聲。十余年來(lái)，DRAM的每字節(jié)成本一直停滯不前，這也是服務(wù)器規(guī)模擴(kuò)大后，DRAM成本在系統(tǒng)成本中占據(jù)主導(dǎo)地位的原因。SRAM同樣面臨類似的瓶頸，我們已無(wú)法制造出尺寸更小的SRAM單元。
 
  對(duì)于SRAM而言，主要限制源于晶體管尺寸已接近原子尺度。制造公差限制了交叉耦合反相器對(duì)的晶體管匹配度，進(jìn)而降低了信號(hào)裕度。不過(guò)，計(jì)算邏輯不受此問(wèn)題的影響，因?yàn)楦骷?jí)電路均可恢復(fù)數(shù)字信號(hào)。對(duì)于DRAM而言，主要制約因素在于高長(zhǎng)寬比電容器的蝕刻成本，以及確保低漏電流的復(fù)雜晶體管幾何結(jié)構(gòu)。更先進(jìn)的制程節(jié)點(diǎn)雖能縮小DRAM單元的物理尺寸，但卻無(wú)法降低單個(gè)存儲(chǔ)單元的成本。我們雖可繼續(xù)制造容量更大的DRAM DIMM，但其每字節(jié)成本并不會(huì)下降。
 
  從這些限制中可以得出的主要結(jié)論是：海量存儲(chǔ)必然伴隨著高昂的成本。片上緩存的增長(zhǎng)速度無(wú)法超越芯片面積的擴(kuò)張，而現(xiàn)代服務(wù)器處理器已然十分龐大（AMD SP5達(dá)5,428mm²）。因此，系統(tǒng)必須更高效地利用存儲(chǔ)資源。


本文關(guān)鍵詞：SRAM,DRAM

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